最近公司承接了一个车载视频拼接的项目，该项目使用到了LVDS高速接口和DDR3接口，摄像头采集的视频图像数据需要先存入DDR3中然后与通过LVDS传输的主机视频数据进行拼接输出，最终在屏幕上显示画中画的效果。在调试DDR3的过程中，我有一些使用心得，特分享给大家。
在之前的文章中我已经介绍过Lattice DDR3的IP核生成使用方法，以及接口信号。也许有许多人不是很明白，明明有DDR3的IP核，为什么还要添加这么一个接口模块，添加了这么一个接口模块主要是用来做什么，需要它设计哪些信号？
图中用红线标记起来的地方就是FPGA与外部DDR3通过引脚连接的接口信号，如果我们通过FPGA内部产生数据并将其送入DDR3中后读出，就是通过这些引脚来传输信号的。我们使用SDRAM进行存储，是直接控制这些输出信号如CAS、RAS、CKE等控制SDRAM读写以及其他各操作的，如下图就是SDRAM的输出控制信号，通过FPGA内部设计CS、RAS、CAS、WE这些信号，可以让SDRAM实现对应的操作。比如我们设计一个SDRAM读操作，那么我们就需要设计CS、RAS、CAS、WE分别为0、1、0、1，SDRAM通过引脚接收到这些信号，便会产生对应的操作，即打开一个新的列地址并开始一个新的突发读操作。
与设计SDRAM接口不同的是，我们在使用DDR3时，是不需要我们亲自设计这些输出信号， 因为我们调用的DDR3 IP核已经帮我们内部封装好了这些指令，我们需要设计的是输入IP核的那部分接口信号，来告诉IP核我们想让DDR3进行工作的模式以及需要DDR3进行的操作。在设计这个接口模块的时候，我们需要设计的就是图1左侧接口的那部分信号，各信号的功能以及时序在数据手册上有详细的说明（在我前面的文章中也有详细的介绍），这需要我们一边对照着数据手册一边进行设计，具体的设计方法我将会在接下来的文章中继续介绍。
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