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【教程】史上最干货的Verilog语法课程_6小时掌握Verilog语法

发布时间:2021-06-29   作者:admin 浏览量:

      你是否存在以下这些情况?

1、 在网络找着零散的资料?

   网络资源多而零散,缺乏系统性,严重影响学习热情;并且网络资源质量参差不齐,很有可能学到一些错误的知识。

2、 拿着厚厚一本Verilog语法书看,看会儿就困?

   语法这部分本来知识点就多,学起来相对枯燥,如果只看书自然会感觉枯燥无聊;走马观花看过一遍,结果发现什么也没记住。

3、 语法上的问题不知道找谁请教?

无人教你,无人指导,无人请教,有些问题难住你,有可能百度都百度不到。


明德扬专注FPGA教育教学8年,积累了丰富的教学资源,具备丰富的教学经验。

最新录制全套Verilog快速掌握课程免费分享给大家。


明德扬VERILOG课程目录:

第一章 硬件描述语言VERILOG

1 Verilog的历史

2 综合和仿真

2.1 综合

2.2 仿真

2.3 可综合设计

3 模块结构

3.1 模块介绍

3.2 模块名和端口定义

3.3 参数定义

3.4 接口定义

3.5 信号类型

3.6 功能描述

3.7 模块例化

4 信号类型

4.1 信号位宽

4.2 线网类型wire

4.3 寄存器类型reg

4.4 wire和reg的区别

5 功能描述-组合逻辑

5.1 程序语句

5.2 数字进制

5.3 算术运算符

5.4 逻辑运算符

5.5 按位逻辑运算符

5.6 关系运算符

5.7 移位运算符

5.8 条件运算符

5.9 拼接运算符

6 功能描述-时序逻辑

6.1 always语句

6.2 D触发器

6.3 时钟

6.4 时序逻辑代码和硬件

6.5 阻塞赋值和非阻塞赋值


配套视频:

  


课程目标:6小时掌握Verilog


课程资料下载链接:https://pan.baidu.com/s/1BAgmlPmgl6smm1vTEIuqcg 
提取码:jcyx


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